Revert "ARM: dts: msm: Update Sun v2 GPU power levels"
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Signed-off-by: Linux Image Build Automation <quic_ibautomat@quicinc.com>
This commit is contained in:
@@ -350,19 +350,19 @@
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#size-cells = <0>;
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#size-cells = <0>;
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qcom,initial-pwrlevel = <12>;
|
qcom,initial-pwrlevel = <12>;
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qcom,speed-bin = <0xe8>;
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qcom,sku-codes = <SKU_CODE(PCODE_UNKNOWN, FC_AB)>;
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/* TURBO_L3 */
|
/* TURBO_L1 */
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qcom,gpu-pwrlevel@0 {
|
qcom,gpu-pwrlevel@0 {
|
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reg = <0>;
|
reg = <0>;
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||||||
qcom,gpu-freq = <1100000000>;
|
qcom,gpu-freq = <1050000000>;
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_TURBO_L3>;
|
qcom,level = <RPMH_REGULATOR_LEVEL_TURBO_L1>;
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||||||
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qcom,bus-freq = <11>;
|
qcom,bus-freq = <11>;
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||||||
qcom,bus-min = <11>;
|
qcom,bus-min = <11>;
|
||||||
qcom,bus-max = <11>;
|
qcom,bus-max = <11>;
|
||||||
|
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||||||
qcom,acd-level = <ACD_LEVEL_TURBO_L3>;
|
qcom,acd-level = <ACD_LEVEL_TURBO_L1>;
|
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};
|
};
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||||||
|
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||||||
/* NOM_L1 */
|
/* NOM_L1 */
|
||||||
@@ -520,177 +520,6 @@
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|||||||
#address-cells = <1>;
|
#address-cells = <1>;
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||||||
#size-cells = <0>;
|
#size-cells = <0>;
|
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||||||
qcom,initial-pwrlevel = <12>;
|
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||||||
qcom,sku-codes = <SKU_CODE(PCODE_UNKNOWN, FC_AB)>;
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/* TURBO_L3 */
|
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||||||
qcom,gpu-pwrlevel@0 {
|
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||||||
reg = <0>;
|
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||||||
qcom,gpu-freq = <1100000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_TURBO_L3>;
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||||||
qcom,bus-freq = <11>;
|
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qcom,bus-min = <11>;
|
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qcom,bus-max = <11>;
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qcom,acd-level = <ACD_LEVEL_TURBO_L3>;
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};
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/* NOM_L1 */
|
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||||||
qcom,gpu-pwrlevel@1 {
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||||||
reg = <1>;
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qcom,gpu-freq = <967000000>;
|
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||||||
qcom,level = <RPMH_REGULATOR_LEVEL_NOM_L1>;
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||||||
qcom,bus-freq = <11>;
|
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||||||
qcom,bus-min = <11>;
|
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qcom,bus-max = <11>;
|
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||||||
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qcom,acd-level = <ACD_LEVEL_NOM_L1>;
|
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};
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/* NOM */
|
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||||||
qcom,gpu-pwrlevel@2 {
|
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||||||
reg = <2>;
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||||||
qcom,gpu-freq = <900000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_NOM>;
|
|
||||||
|
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||||||
qcom,bus-freq = <10>;
|
|
||||||
qcom,bus-min = <7>;
|
|
||||||
qcom,bus-max = <10>;
|
|
||||||
|
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qcom,acd-level = <ACD_LEVEL_NOM>;
|
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||||||
};
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||||||
|
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/* SVS_L2 */
|
|
||||||
qcom,gpu-pwrlevel@3 {
|
|
||||||
reg = <3>;
|
|
||||||
qcom,gpu-freq = <832000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L2>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <10>;
|
|
||||||
qcom,bus-min = <7>;
|
|
||||||
qcom,bus-max = <10>;
|
|
||||||
|
|
||||||
qcom,acd-level = <ACD_LEVEL_SVS_L2>;
|
|
||||||
};
|
|
||||||
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||||||
/* SVS_L1 */
|
|
||||||
qcom,gpu-pwrlevel@4 {
|
|
||||||
reg = <4>;
|
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||||||
qcom,gpu-freq = <734000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L1>;
|
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||||||
|
|
||||||
qcom,bus-freq = <8>;
|
|
||||||
qcom,bus-min = <6>;
|
|
||||||
qcom,bus-max = <10>;
|
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||||||
|
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||||||
qcom,acd-level = <ACD_LEVEL_SVS_L1>;
|
|
||||||
};
|
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||||||
|
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||||||
/* SVS_L0 */
|
|
||||||
qcom,gpu-pwrlevel@5 {
|
|
||||||
reg = <5>;
|
|
||||||
qcom,gpu-freq = <660000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L0>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <6>;
|
|
||||||
qcom,bus-min = <4>;
|
|
||||||
qcom,bus-max = <7>;
|
|
||||||
|
|
||||||
qcom,acd-level = <ACD_LEVEL_SVS_L0>;
|
|
||||||
};
|
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||||||
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||||||
/* SVS */
|
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||||||
qcom,gpu-pwrlevel@6 {
|
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||||||
reg = <6>;
|
|
||||||
qcom,gpu-freq = <607000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_SVS>;
|
|
||||||
|
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||||||
qcom,bus-freq = <6>;
|
|
||||||
qcom,bus-min = <4>;
|
|
||||||
qcom,bus-max = <7>;
|
|
||||||
|
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||||||
qcom,acd-level = <ACD_LEVEL_SVS>;
|
|
||||||
};
|
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||||||
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||||||
/* Low_SVS_L1 */
|
|
||||||
qcom,gpu-pwrlevel@7 {
|
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||||||
reg = <7>;
|
|
||||||
qcom,gpu-freq = <525000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_L1>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <4>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <6>;
|
|
||||||
|
|
||||||
qcom,acd-level = <ACD_LEVEL_LOW_SVS_L1>;
|
|
||||||
};
|
|
||||||
|
|
||||||
/* Low_SVS */
|
|
||||||
qcom,gpu-pwrlevel@8 {
|
|
||||||
reg = <8>;
|
|
||||||
qcom,gpu-freq = <443000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <4>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <6>;
|
|
||||||
|
|
||||||
qcom,acd-level = <ACD_LEVEL_LOW_SVS>;
|
|
||||||
};
|
|
||||||
|
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||||||
/* Low_SVS_D0 */
|
|
||||||
qcom,gpu-pwrlevel@9 {
|
|
||||||
reg = <9>;
|
|
||||||
qcom,gpu-freq = <389000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D0>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <4>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <6>;
|
|
||||||
|
|
||||||
qcom,acd-level = <ACD_LEVEL_LOW_SVS_D0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
/* Low_SVS_D1 */
|
|
||||||
qcom,gpu-pwrlevel@10 {
|
|
||||||
reg = <10>;
|
|
||||||
qcom,gpu-freq = <342000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D1>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <3>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <3>;
|
|
||||||
};
|
|
||||||
|
|
||||||
/* Low_SVS_D2 */
|
|
||||||
qcom,gpu-pwrlevel@11 {
|
|
||||||
reg = <11>;
|
|
||||||
qcom,gpu-freq = <222000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D2>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <3>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <3>;
|
|
||||||
};
|
|
||||||
|
|
||||||
/* Low_SVS_D3 */
|
|
||||||
qcom,gpu-pwrlevel@12 {
|
|
||||||
reg = <12>;
|
|
||||||
qcom,gpu-freq = <160000000>;
|
|
||||||
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D3>;
|
|
||||||
|
|
||||||
qcom,bus-freq = <3>;
|
|
||||||
qcom,bus-min = <2>;
|
|
||||||
qcom,bus-max = <3>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
qcom,gpu-pwrlevels-4 {
|
|
||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
|
|
||||||
|
|
||||||
qcom,initial-pwrlevel = <13>;
|
qcom,initial-pwrlevel = <13>;
|
||||||
qcom,speed-bin = <0xf2>;
|
qcom,speed-bin = <0xf2>;
|
||||||
|
|
||||||
@@ -871,13 +700,196 @@
|
|||||||
};
|
};
|
||||||
};
|
};
|
||||||
|
|
||||||
|
qcom,gpu-pwrlevels-4 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
qcom,initial-pwrlevel = <13>;
|
||||||
|
qcom,sku-codes = <SKU_CODE(PCODE_UNKNOWN, FC_AC)>;
|
||||||
|
|
||||||
|
/* TURBO_L3 */
|
||||||
|
qcom,gpu-pwrlevel@0 {
|
||||||
|
reg = <0>;
|
||||||
|
qcom,gpu-freq = <1150000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_TURBO_L3>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <11>;
|
||||||
|
qcom,bus-min = <11>;
|
||||||
|
qcom,bus-max = <11>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_TURBO_L3>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* TURBO_L1 */
|
||||||
|
qcom,gpu-pwrlevel@1 {
|
||||||
|
reg = <1>;
|
||||||
|
qcom,gpu-freq = <1050000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_TURBO_L1>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <11>;
|
||||||
|
qcom,bus-min = <11>;
|
||||||
|
qcom,bus-max = <11>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_TURBO_L1>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* NOM_L1 */
|
||||||
|
qcom,gpu-pwrlevel@2 {
|
||||||
|
reg = <2>;
|
||||||
|
qcom,gpu-freq = <967000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_NOM_L1>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <11>;
|
||||||
|
qcom,bus-min = <11>;
|
||||||
|
qcom,bus-max = <11>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_NOM_L1>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* NOM */
|
||||||
|
qcom,gpu-pwrlevel@3 {
|
||||||
|
reg = <3>;
|
||||||
|
qcom,gpu-freq = <900000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_NOM>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <10>;
|
||||||
|
qcom,bus-min = <7>;
|
||||||
|
qcom,bus-max = <10>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_NOM>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* SVS_L2 */
|
||||||
|
qcom,gpu-pwrlevel@4 {
|
||||||
|
reg = <4>;
|
||||||
|
qcom,gpu-freq = <832000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L2>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <10>;
|
||||||
|
qcom,bus-min = <7>;
|
||||||
|
qcom,bus-max = <10>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_SVS_L2>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* SVS_L1 */
|
||||||
|
qcom,gpu-pwrlevel@5 {
|
||||||
|
reg = <5>;
|
||||||
|
qcom,gpu-freq = <734000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L1>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <8>;
|
||||||
|
qcom,bus-min = <6>;
|
||||||
|
qcom,bus-max = <10>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_SVS_L1>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* SVS_L0 */
|
||||||
|
qcom,gpu-pwrlevel@6 {
|
||||||
|
reg = <6>;
|
||||||
|
qcom,gpu-freq = <660000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_SVS_L0>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <6>;
|
||||||
|
qcom,bus-min = <4>;
|
||||||
|
qcom,bus-max = <7>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_SVS_L0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* SVS */
|
||||||
|
qcom,gpu-pwrlevel@7 {
|
||||||
|
reg = <7>;
|
||||||
|
qcom,gpu-freq = <607000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_SVS>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <6>;
|
||||||
|
qcom,bus-min = <4>;
|
||||||
|
qcom,bus-max = <7>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_SVS>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS_L1 */
|
||||||
|
qcom,gpu-pwrlevel@8 {
|
||||||
|
reg = <8>;
|
||||||
|
qcom,gpu-freq = <525000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_L1>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <4>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <6>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_LOW_SVS_L1>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS */
|
||||||
|
qcom,gpu-pwrlevel@9 {
|
||||||
|
reg = <9>;
|
||||||
|
qcom,gpu-freq = <443000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <4>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <6>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_LOW_SVS>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS_D0 */
|
||||||
|
qcom,gpu-pwrlevel@10 {
|
||||||
|
reg = <10>;
|
||||||
|
qcom,gpu-freq = <389000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D0>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <4>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <6>;
|
||||||
|
|
||||||
|
qcom,acd-level = <ACD_LEVEL_LOW_SVS_D0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS_D1 */
|
||||||
|
qcom,gpu-pwrlevel@11 {
|
||||||
|
reg = <11>;
|
||||||
|
qcom,gpu-freq = <342000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D1>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <3>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <3>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS_D2 */
|
||||||
|
qcom,gpu-pwrlevel@12 {
|
||||||
|
reg = <12>;
|
||||||
|
qcom,gpu-freq = <222000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D2>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <3>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <3>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* Low_SVS_D3 */
|
||||||
|
qcom,gpu-pwrlevel@13 {
|
||||||
|
reg = <13>;
|
||||||
|
qcom,gpu-freq = <160000000>;
|
||||||
|
qcom,level = <RPMH_REGULATOR_LEVEL_LOW_SVS_D3>;
|
||||||
|
|
||||||
|
qcom,bus-freq = <3>;
|
||||||
|
qcom,bus-min = <2>;
|
||||||
|
qcom,bus-max = <3>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
qcom,gpu-pwrlevels-5 {
|
qcom,gpu-pwrlevels-5 {
|
||||||
#address-cells = <1>;
|
#address-cells = <1>;
|
||||||
#size-cells = <0>;
|
#size-cells = <0>;
|
||||||
|
|
||||||
qcom,initial-pwrlevel = <14>;
|
qcom,initial-pwrlevel = <14>;
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